Chips para sintetizadores de frecuencia digital KF1015PLZA, KF1015PLZB. Esquema, descripción

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Chips para sintetizadores de frecuencia digital KF1015PLZA, KF1015PLZB. Enciclopedia de radioelectrónica e ingeniería eléctrica.

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Enciclopedia de radioelectrónica e ingeniería eléctrica. / Aplicación de microcircuitos

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Los microcircuitos de alta velocidad KF1015PLZA y KF1015PLZB están diseñados para construir modernos sintetizadores digitales de frecuencia con PLL para bandas de ondas HF, VHF y decimétricas. Los dispositivos están fabricados con tecnología CMOS con puerta de polisilicio.

Los microcircuitos de la serie KF1015PLZ se producen en un paquete en miniatura de plástico de 16 pines 4308.16-1 (Fig. 1). Peso del dispositivo: no más de 0,3 g.

Chips para sintetizadores de frecuencia digital KF1015PLZA, KF1015PLZB
Ris.1

El microcircuito incluye (ver el diagrama de bloques en la Fig. 2) un generador de frecuencia de referencia, un divisor de frecuencia de referencia, un amplificador-modelador de pulsos de RF de entrada, una ruta de divisor de frecuencia binaria con una relación de división programable, que consta de un preliminar de dos módulos divisor de frecuencia por 31 ó 32, contador de control prescaler de cinco bits, doce dígitos senior de un divisor programable y una unidad de control lógico, un detector de frecuencia-fase y registros de recepción y buffer de veinte bits.

Fig.2 (haga clic para ampliar)

El microcircuito incluido en un circuito típico con componentes adjuntos es capaz de operar en sintetizadores digitales con un PLL de rangos de metros y decímetros con un consumo de energía reducido.

Pinout del microcircuito: pin. 1 - común para los registros de recepción y búfer, la ruta del divisor de frecuencia programable y el detector de fase de frecuencia, salida de potencia negativa; alfiler. 2 - salida de carga del detector de fase de frecuencia (drenaje de un transistor de efecto de campo con un canal p); alfiler. 3 - salida de bits de un detector de fase de frecuencia (drenaje de un transistor de efecto de campo con un canal n); alfiler. 4 - salida de control de indicación de sincronización de fase en el bucle PLL; alfiler. 5 - Entrada de RF del amplificador-modelador de la ruta del divisor programable; alfiler. 6 - salida de divisor programable; alfiler. 7 - permiso de entrada para reescribir información desde el registro receptor al búfer (T); alfiler. 8 - entrada de pulsos de reloj para registrar información (C); alfiler. 9 - salida de potencia positiva; alfiler. 10 - información de registro de entrada sobre los coeficientes de división (D); alfiler. 11 - salida para conectar un resonador de cuarzo; salida ejemplar del generador de frecuencia; alfiler. 12 - salida para conectar un resonador de cuarzo; entrada de señal de un generador de frecuencia de referencia externo; alfiler. 13 - señal de entrada para apagar la salida del divisor de la frecuencia de referencia (en el nivel 1); alfiler. 14 - salida del divisor de frecuencia de referencia (en el nivel 0 en el pin 13) o entrada del detector de fase de frecuencia (en el nivel 1 en el pin 13); alfiler. 15 - común para el generador y el divisor de frecuencia de referencia, salida de potencia negativa; alfiler. 16 - salida de control del registro receptor.

Características principales a Tacr.av=25±10°C y tensión de alimentación 5 V

Tensión nominal de alimentación, V ............... .4,5...5,5
Límites del divisor de ruta del divisor de frecuencia programable ......992-131071
Paso divisor programable .................................................. ... 1
Relaciones de división del divisor de frecuencia de referencia ........100,200 400,512, 640,800, 1000,1024
Intervalo de frecuencia de entrada de divisor programable, MHz, para KF1015PLZA ........ .50...1000 KF1015PLZB ..........20...800
Intervalo de frecuencia de entrada del divisor de frecuencia de referencia, MHz .......................1 ... 50
Sensibilidad del amplificador de conformación, Veff, (valor más bajo - para frecuencia dentro de 50...500 MHz) ..............0,2...0,9
Sensibilidad a la entrada del generador de frecuencia de referencia (para un oscilador de cuarzo externo), mVeff. ..........100...150
Consumo máximo de corriente, mA, no más ............... 15
Impedancia de salida de las salidas del detector de fase de frecuencia, Ohm, no más
Impedancia de salida del divisor de frecuencia de referencia, Ohm, no más de ..........200
Impedancia de salida de la salida de control de indicación de sincronización de fase, Ohm, no más de .................................. 200
Impedancia de salida del generador de frecuencia ejemplar, Ohm, no más de .......... 200
La corriente de entrada de la entrada para reescribir información desde el registro de recepción al búfer (pin 7), la entrada de pulsos de reloj para escribir información (pin 8), la entrada para registrar información sobre la relación de división (pin 10) y la entrada de la señal para apagar la salida del divisor de frecuencia de referencia (pin. 13), µA, no más de ......................±1
La corriente de entrada de la entrada de RF del amplificador-modelador (pin 5) y la entrada del generador de frecuencia de referencia (pin 12), µA, para una señal de bajo nivel, no menos ... -30 de alto nivel, no más de . .+30

Valores límite

Valores límite de la tensión de alimentación, V ........3...6
El potencial electrostático más alto, V, no menos de ............... 150
Rango de temperatura ambiente de funcionamiento, °С ... .-60 ... +70
Valores límite de temperatura ambiente, °С ................-70;+85

En la fig. 3 muestra uno de los posibles esquemas para encender el dispositivo. Al elegir un resonador de cuarzo para un generador de frecuencia de referencia, se debe tener en cuenta que el resonador debe operar en una resonancia paralela, cuya frecuencia es mayor que la frecuencia en serie. Conectando una bobina con una inductancia de 10 μH en serie con el resonador, es posible acercarse a la frecuencia de la resonancia en serie, cuyo valor suele estar marcado con un resonador de cuarzo.

Fig.3 (haga clic para ampliar)

Al ajustar el capacitor C1, se logra una generación estable, que se puede ver al eliminar la señal del pin. 11 microchips. En modo normal, esta señal es una sinusoide con una amplitud doble de 1 ... 1.2 V con un componente constante de aproximadamente la mitad de Upit.

Si se usa un oscilador de cuarzo estable externo como referencia, su señal de salida con un voltaje de 100 ... 250 mV se alimenta al pin. 12 a través de un condensador de aislamiento con una capacidad de 1000 ... 10 pF.

Se puede lograr una reducción significativa en el consumo de energía (cuando se opera a una frecuencia de hasta 600 MHz) al reducir el voltaje de suministro a 3,3 ... 4 V. En este caso, el consumo de corriente se reduce a 4 ... .

Autores: V. Melnik, V. Nikitin, Moscú; Publicación: N. Bolshakov, rf.atnn.ru

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