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ENCICLOPEDIA DE RADIOELECTRÓNICA E INGENIERÍA ELÉCTRICA
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Familia de procesadores de señal digital TDA755X. Dato de referencia

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Enciclopedia de radioelectrónica e ingeniería eléctrica. / Aplicación de microcircuitos

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La familia TDA755X de procesadores de señales digitales de alto rendimiento está diseñada para resolver problemas en el campo del reconocimiento y síntesis de voz, supresión de eco y ruido.

Tenga en cuenta las características de los procesadores de señal de la familia TDA755X

  • Núcleo informático de 24 bits;
  • una gran cantidad de memoria integrada (hasta 16 Kpalabras de ROM/RAM y hasta 16 Kpalabras de RAM);
  • DAC y ADC de 2 canales integrados con capacidad de 16 bits;
  • frecuencia de muestreo controlable de 4 a 48 kHz;
  • controlador de memoria adicional incorporado con soporte para memoria flash, RAM estática y dinámica;
  • interfaz serial operando en modos I2C o SPI.

El diagrama de bloques de los microcircuitos se muestra en la Fig. 1, la asignación de pines se encuentra en la tabla. 1, y la distribución de pines está en la Fig. 2.

Familia de procesadores de señal digital TDA755X. Dato de referencia. Diagrama de bloques de chips
Arroz. 1. Diagrama de bloques de microcircuitos

Familia de procesadores de señal digital TDA755X. Dato de referencia. Asignación de pines del circuito
Arroz. 2. Pinout de microcircuitos

Los microcircuitos incluyen tres módulos principales: un procesador de señal digital (DSP) de 24 bits, memoria (ROM y RAM) y periféricos.

Parámetros y funciones del núcleo del procesador:

  • frecuencia de reloj 50 MHz;
  • las operaciones de suma y multiplicación se realizan en un ciclo de reloj;
  • dos acumuladores de 56 bits;
  • instrucciones de carga de registro de 48 bits o paralelo de 24 bits;
  • 64 vectores de interrupción;
  • la posibilidad de prohibición de programas y enmascaramiento de interrupciones;
  • comandos de organización de ciclos;
  • tres buses de datos;
  • tres buses de direcciones.

La memoria integrada incluye 16384 palabras de 24 bits de ROM y la misma cantidad de RAM Los dispositivos periféricos incluyen una interfaz de audio en serie, interfaz I2C/SPI, interfaz de memoria externa, generador de reloj, códec (codificador/decodificador).

Tabla 1

Número de salida designación Categoría de señal breve descripción
1 - 2 EMI_AD5 entrada salida Dirección multiplexada/bus de datos de interfaz de memoria externa
3 VDD entrada Tensión de alimentación de la parte digital del microcircuito.
4 GND entrada Cable de alimentación común
5 EMI_AD7 entrada salida Dirección multiplexada/señal de bus de datos de la interfaz de memoria externa
06 - 13 EMI_A8/A15 salida Bus de direcciones de interfaz de memoria externa
14 VDD entrada Tensión de alimentación de la parte digital del microcircuito.
15 GND entrada Cable de alimentación común
16 - 21 EMI_A16/A21 salida Bus de direcciones de interfaz de memoria externa
22 DWRN salida Señal de "escritura" de interfaz de memoria externa
23 TEST1 entrada Entrada de prueba #1 (nivel activo - alto)
24 TEST2 entrada Entrada de prueba n.º 2 (activa - baja)
25 MISO entrada salida Salida de datos en modo SPI Master, entrada de datos en modo SPI Slave
26 MOSI entrada salida Entrada de datos en modo maestro SPI, salida de datos en modo esclavo SPI
27 VDD entrada Tensión de alimentación de la parte digital del microcircuito.
28 GND entrada General
29 TEST3 entrada Entrada de prueba #3 (nivel activo - alto)
30 SDI entrada Datos de la interfaz de audio en serie
31 SCK entrada salida Reloj de audio en serie
32 LRCK entrada salida Señal de reloj de control (canal derecho/izquierdo) de la interfaz de audio serie
33 VDD entrada Tensión de alimentación de la parte digital
34 GND entrada General
35 SDO salida Salida de datos de interfaz de audio en serie
36 GPIO1 entrada salida Puerto de E/S programable
37 GPIOO entrada salida - "-
38 GPIO5 entrada salida - "-
39 DBCK entrada salida Puerto de depuración Reloj/Estado n.° 1 Se puede usar como una señal GPIO9
40 DBIN entrada salida Entrada de datos del puerto de depuración/señal de estado #0 Se puede utilizar como señal GPIO11
41 DESCUBIERTA entrada salida Salida de datos serie del puerto de depuración Se puede utilizar como una señal GPIO10
42 DBRQN entrada Señal de solicitud de modo de depuración
43 NRESETABLE entrada Reinicio de Chip Master activo bajo
44 INTN entrada Señal de interrupción externa Activo bajo
45 SCL/SCK entrada salida
entrada salida
Reloj de interfaz I2С
En modo de interfaz SPI, reloj de bus SPI
46 ASD/SS entrada salida
entrada
Datos de interfaz I2C
En modo serie SPI - señal de selección de esclavo
47 VDD entrada Tensión de alimentación de la parte digital
48 GND entrada General
49 GPIO2 entrada salida Puerto de E/S programable
50 GPIO6 entrada salida - "-
51 GPIO3 entrada salida - "-
52 CGND entrada General
53 CVDD entrada Tensión de alimentación del módulo de códec
54 VOUTR salida Señal analógica de DAC (canal derecho)
55 VSALIDA salida Señal analógica de DAC (canal izquierdo)
56 VDD entrada Tensión de alimentación de la parte digital
57 GND entrada General
58 VINR entrada Señal analógica para ADC (canal derecho)
59 VINILO entrada Señal analógica para ADC (canal izquierdo)
60 CGND entrada General
61 TEST4 salida Conectado con resistencia de terminación de 22 kΩ
62 CVDDA entrada Tensión de alimentación del módulo de códec
63 VREF salida Tensión de referencia del módulo de códec
64 REFCAP salida Condensador de derivación para salida de referencia
65 GPIO7 entrada salida Puerto de E/S programable
66 GPIO4 entrada salida - "-
67 VDD entrada Tensión de alimentación de la parte digital
68 CLKOUT salida Señal de reloj del divisor de frecuencia
69 XTI entrada Conexión de un resonador de cuarzo
70 PGND entrada General
71 PVCC entrada Tensión de alimentación del reloj
72 XTO salida Conexión de un resonador de cuarzo
73 DE salida Confirmación de dirección en bus de interfaz de memoria externa (activo alto)
74 GND entrada General
75 DRDN salida Señal de "lectura" de interfaz de memoria externa
76 - 80 EMI_AD0/AD4 entrada salida Dirección multiplexada/señal de bus de datos de la interfaz de memoria externa

La interfaz de audio en serie transmite audio digital desde una fuente externa al DSP del chip, así como datos digitales desde el DSP a un DAC externo.

Interfaces I2C/SPI conecta chips a otro hardware compatible con estas interfaces.

La interfaz de memoria externa le permite acceder a bancos de memoria adicionales instalados fuera del chip. Se admiten la memoria dinámica de acceso aleatorio (DRAM), la memoria estática de acceso aleatorio (SRAM) y la memoria no volátil (FLASH).

Parámetros y funciones de la interfaz de memoria externa:

  • bus de datos de 4 bits para RAM dinámica (DRAM) y de 8 bits para RAM estática (SRAM);
  • El bus de direcciones de 22 bits se multiplexa con el bus de datos de 8 bits;
  • la capacidad de acceder a un byte, una palabra de 16 bits y una palabra de 24 bits cuando se trabaja con RAM estática y dinámica;
  • memoria direccionable cuando se trabaja con RAM dinámica de hasta 256 Mbit;
  • RAM estática direccionable de 4 MB.

El generador de reloj de chip genera las siguientes señales de reloj:

  • DCLK - señal de reloj para DSP;
  • MCLK - señal de referencia del códec;
  • LRCLK: señal de reloj para los canales derecho/izquierdo de la interfaz de audio en serie y el códec;
  • Señal de cambio de reloj para interfaz de audio serie y códec.

Parámetros y funciones del códec:

  • conversión delta-sigma de analógico a digital de la señal estéreo de entrada;
  • Rango dinámico ADC - 80 dB;
  • conversión de digital a analógico delta-sigma de la señal estéreo digital de salida;
  • frecuencia de muestreo de 4 a 48 kHz;
  • entrada y salida digital a través de la interfaz de audio en serie.

La funcionalidad de los microcircuitos se da en la Tabla 2.

Tabla 2

Designacion tipo
memoria para
programas
Función principal régimen
placenta.
interfaz
ext.
memoria
Audio
entrada
Audio
salida
Programa
proveer
TDA7550R robo Para elegir Maestro o esclavo I2C FLASH o RAM Sí (aplicación especificada) Sí (aplicación especificada) Def.
aplicar
TDA7550 PFU Reconocimiento de voz Esclavo I2C FLASH si (voz) si (voz) ASR 311 Lernout &
hauspie
TDA7551 - Reconocimiento de voz Esclavo I2C FLASH si (voz) si (voz) SV208 Lernout y
hauspie
TDA7552 - Sintetizador de voz Esclavo I2C - No TTS3000 Lernout y
hauspie
TDA7553 - Filtrado de señales digitales Maestro i2C o SPI (RAM) Sí (señal sin procesar) Sí (señal procesada) programa
procesamiento NCTI

El uso de microcircuitos de la serie TDA755X.

El chip TDA7550 con el software ASR311 le permite implementar un sistema de reconocimiento de voz.Parámetros y funciones de dicho sistema:

  • reconocimiento de alta calidad de palabras del conjunto básico en una amplia gama de cambios en los parámetros de voz;
  • alta inmunidad al ruido del algoritmo de reconocimiento;
  • memorización de nuevas palabras además del conjunto básico;
  • la capacidad de grabar mensajes de voz en una memoria FLASH externa para admitir la interfaz de voz;
  • todas las funciones del sistema se controlan a través de la interfaz I2C;
  • conjuntos básicos de palabras están disponibles para la mayoría de los idiomas comunes;
  • La memoria FLASH externa se utiliza para almacenar el conjunto de palabras básico (4 KB por palabra), el conjunto de palabras adicional (4 KB/palabra) y los mensajes de voz (11 KB/seg., frecuencia de muestreo de 11025 Hz).

El diagrama de bloques del sistema de reconocimiento de voz se muestra en la Figura 3.

Familia de procesadores de señal digital TDA755X. Dato de referencia. Diagrama de bloques de un sistema de reconocimiento de voz
Arroz. 3. Diagrama de bloques de un sistema de reconocimiento de voz

El chip TDA7551 es una solución de paquete único para sistemas de identificación por voz que utilizan el software SV208. Las frases de contraseña se recuerdan cuando se repiten tres veces (duración de la frase: 1 2 s). Posteriormente, la frase de contraseña pronunciada se compara con los parámetros de las frases de contraseña almacenadas en la memoria no volátil del sistema. El control de las funciones del chip se realiza a través de la interfaz serie I.2C.

El diagrama de bloques del sistema de identificación de voz se muestra en la Figura 4.

Familia de procesadores de señal digital TDA755X. Dato de referencia. Diagrama de bloques de un sistema de identificación de voz
Arroz. 4. Diagrama de bloques del sistema de identificación de voz

El chip TDA7552 está diseñado para usarse como parte de un sistema de síntesis de voz de texto a voz. Para construir un sistema de este tipo, además del DSP TDA7552, se requiere un microcontrolador ST1O para analizar y convertir cadenas de texto de entrada.

El diagrama de bloques del sistema de síntesis de voz se muestra en la fig. 5.

Familia de procesadores de señal digital TDA755X. Dato de referencia. Diagrama de bloques de un sistema de síntesis de voz
Arroz. 5. Diagrama de bloques del sistema de síntesis de voz

El dispositivo externo envía cadenas de texto al microcontrolador como un flujo de caracteres ASCII.

El microcontrolador analiza y convierte los datos entrantes, teniendo en cuenta el idioma utilizado (la información sobre la conversión para varios idiomas está contenida en una memoria FLASH externa a la que tiene acceso el microcontrolador). El microcontrolador envía los datos convertidos a través del bus I2C al chip TDA7552, que convierte los datos recibidos en una señal de voz.

El software del procesador de señales TDA7552 es independiente del idioma del texto de entrada y no requiere memoria externa adicional.

Publicación: cxem.net

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Las mediciones precisas de la masa de neutrinos han requerido que los científicos sean creativos. El núcleo del experimento KATRIN es un contenedor de 10 metros que contiene 25 gramos del isótopo radiactivo de hidrógeno, tritio. Este hidrógeno se enfría a una temperatura ultrabaja y en su entorno se produce constantemente la denominada desintegración beta, por lo que uno de los neutrones se convierte en protón, generando un electrón adicional y un antineutrino electrónico, cuya masa corresponde a la masa de un neutrino electrónico ordinario.

Los productos de la desintegración beta caen en la región activa de un sensor-espectrómetro, del tamaño de un edificio residencial, que permite medir la energía de los electrones. La esencia del experimento es que el electrón y el neutrino siempre reciben parte de la energía liberada durante la reacción de decaimiento. Este número puede fluctuar de un caso a otro, pero la proporción de distribución de energía entre el electrón y el neutrino siempre permanece igual. Y como resultado del funcionamiento del sensor, se obtiene un gráfico cuya forma le permite calcular la energía máxima para cada "estado de masa" del neutrino.

Luego de 28 días de trabajo y recolección de datos, los científicos del experimento KATRIN obtuvieron el valor mínimo de la suma promedio de los tres estados de masa de los neutrinos a un nivel menor a 0.1 eV (electron volt), el valor máximo de este parámetro fue de 1.1 eV. A modo de comparación, la masa-energía de un electrón es de unos 500 mil eV, y la de un protón es de casi mil millones.

El valor obtenido de la masa máxima de neutrinos es casi dos veces menor que los valores dados por otros experimentos, por ejemplo, recientemente, los científicos, utilizando partículas cósmicas de neutrinos, obtuvieron un valor de masa de 2.6 eV. Sin embargo, aquí se debe tener en cuenta que los datos del experimento KATRIN se recopilaron en solo un mes, y los científicos aún tienen cinco años por delante, durante los cuales recopilarán y analizarán nuevos datos.

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